TSMC prepara el proceso N4C de 4 nm más barato para 2025, con el objetivo de reducir costes en un 8,5%

Si bien la mayor parte de la atención de TSMC se centra en sus nodos de vanguardia, como el N3E y el N2, en los próximos años se seguirán fabricando muchos chips utilizando tecnologías de proceso más maduras y probadas. Es por eso que TSMC ha seguido perfeccionando sus nodos existentes, incluidas las ofertas de clase de 5 nm de última generación. Con este fin, en el Simposio Tecnológico de América del Norte 2024, la compañía presentó un nuevo nodo optimizado de clase 5 nm: N4C. El proceso N4C de TSMC pertenece a la familia de nodos fabulosos de clase 5 nm de la compañía y es un superconjunto de N4P, la tecnología más avanzada de esa familia. En un esfuerzo por reducir aún más los costos de fabricación de 5 nm, TSMC está implementando varios cambios para N4C, incluido el rediseño de la celda estándar y la celda SRAM, cambiando algunas reglas de diseño y reduciendo la cantidad de capas de enmascaramiento. Como resultado de estas mejoras, la compañía espera que N4C logre tamaños de molde más pequeños y una reducción en la complejidad de fabricación, lo que a su vez reducirá los costos de los moldes hasta en un 8,5 %. Además, con la misma tasa de densidad de defectos a nivel de oblea que el N4P, el N4C ofrece rendimientos funcionales aún mayores gracias a un área de matriz reducida. «Entonces, no hemos terminado con nuestros 5 nm y 4 nm. [technologies]»dijo Kevin Zhang, vicepresidente de desarrollo comercial de TSMC. «De N5 a N4, hemos logrado una mejora del 4% en la reducción de la densidad óptica y continuamos mejorando el rendimiento del transistor. Ahora incluimos N4C en nuestra cartera de tecnología de 4 nm. N4C permite a nuestros clientes reducir costos al eliminar algunas máscaras y también mejorar el diseño IP original, como una celda estándar y SRAM, para reducir aún más el costo general de propiedad a nivel de producto». TSMC dice que N4C puede usar la misma infraestructura de diseño que N4P , aunque no está claro si N5 y N4P IP se pueden reutilizar para chips basados ​​en N4C. Mientras tanto, TSMC indica que ofrece varias opciones a los fabricantes de chips para encontrar el equilibrio adecuado entre ventajas de costes y esfuerzo de diseño, por lo que las empresas están interesadas en adoptar uno de 4 nm. El desarrollo de N4C se produce cuando muchos de los clientes de diseño de chips de TSMC se están preparando para lanzar chips basados ​​en la última generación de la tecnología de proceso FinFET de la compañía, la serie N3 de 3 nm, mientras que se espera que N3 sea una familia exitosa. , los altos costos de N3B han sido un problema y la generación se caracteriza por un rendimiento y una densidad de transistores decrecientes. Como resultado, N4C podría convertirse en un nodo importante y de larga duración en TSMC, sirviendo como un activo adecuado para los clientes que buscan quedarse con un nodo FinFET más asequible. «Esta es una mejora muy significativa, estamos trabajando con nuestro cliente, básicamente para extraer más valor de su inversión en 4 nm», dijo Zhang. TSMC planea comenzar la producción en volumen de chips N4C el próximo año. Y dado que TSMC ha estado produciendo la clase de 5 nm durante casi media década en ese momento, N4C debería poder comenzar a funcionar en términos de volumen y rendimiento. Lectura relacionada

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